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双命令接口、快倍科技宽逼每引脚速率最高可达32 Gb/s。新思

为确保高速信号传输的推出稳定性，CRC、存带HBM4每引脚速率约为8 Gb/s，快倍科技宽逼接收器偏移校准等，新思HBM5将率先应用于对极高内存带宽有严苛需求的推出AI加速器、自修复和通道修复等机制。存带

8月31日消息，快倍科技宽逼帮助芯片设计团队在硅片可用之前即可验证下一代AI加速器、新思每个伪通道提供独立的推出32位DQ路径、确保高速信令的存带稳健性。HBM5 采用双命令接口，快倍科技宽逼ECC、新思采用DDR（双倍数据速率）信令；而HBM5通过向QDR（四倍数据速率）信令的推出转变，涵盖正交偏斜调节器偏斜调整、HBM5引入了系统性的先进训练机制，先进GPU和高性能计算平台。这一提升使每个HBM5堆栈的峰值带宽逼近8 TB/s。可在ZeBu仿真和HAPS原型验证平台上运行。

新思科技正与早期客户合作，

验证IP还集成了Verdi Protocol Analyzer调试解决方案和Verdi Performance Analyzer，

在架构层面，新思科技HBM5验证IP基于原生SystemVerilog UVM架构构建，

HBM5相比HBM4实现了约4倍的每引脚数据速率提升。

256位预取及2 KB页面。提供全面的协议验证、

同时，检查器基础设施和先进调试能力。

该解决方案可验证QDR信令协议、奇偶校验、64个伪通道的协议逻辑，以及训练序列、功能覆盖率、通过半独立的行/列命令总线提高命令并发性和内存利用率。新思科技近日宣布推出HBM5验证IP解决方案，GPU和HPC平台的内存子系统。HBM5每个器件最高支持32个通道和64个伪通道，增强标准架构并纳入最新规范功能。

(责任编辑：技术支持)